Drawing: |
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Earlier published in: |
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IEC 60617-12 (ed.3.0) 12-28-09 |
Description (temporary field): |
EN |
Exclusive-OR, with complementary outputs and one common output, quintuple
(e.g. F 100107)
NOTE - One output of each of the five elements is internally connected to an input of the common output element. The internal logic state of this input corresponds with that of the output to which it is connected and does not depend on the choice of that output because both outputs of each element have identical internal logic states (see section 6). |
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FR |
OU exclusif, quintuple, avec sorties complémentaires et une sortie commune
(modèle d'antériorité : F 100107)
NOTE - II n'est pas utile de préciser avec laquelle des deux sorties de chacun des 5 opérateurs une entrée de l'opérateur commun de sortie a une connexion interne, puisque l'état logique interne est le même pour les deux sorties (voir la section 6). |
Name: |
EN |
Exclusive-OR, with complementary outputs and one common output, quintuple |
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FR |
OU exclusif, quintuple, avec sorties complémentaires et une sortie commune |
Alternative names: |
EN |
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FR |
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Keywords: |
EN |
binary logic circuits; combinative circuits |
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FR |
circuits combinatoires, circuits logiques binaires |
Form: |
EN |
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FR |
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Alternative forms: |
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Applied in: |
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Applies: |
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S01465, S01494, S01566, S01574 |
Application notes: |
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A00269, A00271 |
Source references: |
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Published in: |
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Entered on: |
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2003-11-28 |
Evaluated on: |
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2003-11-28 |
Released on: |
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2004-09-01 |
Rejected on: |
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Obsolete from: |
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Proposed by: |
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TC3 |
Replaces: |
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Replaced by: |
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Shape class: |
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Characters, Rectangles |
Function class: |
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K Processing signals or information |
Application class: |
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Circuit diagrams, Function diagrams |
Symbol restrictions: |
EN |
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FR |
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Remarks: |
EN |
(e.g. F 100107)
One output of each of the five elements is internally connected to an input of the common output element. The internal logic state of this input corresponds with that of the output to which it is connected and does not depend on the choice of that output because both outputs of each element have identical internal logic states (see application note A00271).
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FR |
(modèle d'antériorité : F 100107)
II n'est pas utile de préciser avec laquelle des deux sorties de chacun des 5 opérateurs une entrée de l'opérateur commun de sortie a une connexion interne, puisque l'état logique interne est le même pour les deux sorties (voir la note d'application A00271).
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Change requests: |
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C00112, C00139, C00189, C00190 |